北航计算机组成课Project5资源。包含:全套流水线cpu源代码,数据通路设计和暂停转发分析excel表,和覆盖所有冲突情况的Mips汇编强测代码。
2019-12-21 20:58:02 636KB 北航计组 Project5 流水线CPU 暂停转发
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三级流水线CPU的实现成功在FPGA开发板上通过此CPU实现流水灯的运行。该CPU实现了十多条常用指令,代码中含有指令结构和详细介绍。通过DEBUG分析,最后得到的频率有200多M
2019-12-21 20:57:05 142KB verilo CPU
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Verilog实现MIPS处理器部分指令,不乏存在错误,还请指出。
2019-12-21 20:52:48 179KB MIPS
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计算机组成 简单流水线cpu的设计 1.解决数据冒险和结构冒险 2.实现周期结束后各阶段的锁存 3.实现内部前推
2019-12-21 20:52:33 2.5MB cpu vivado verilog
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我们学校(某中部985高校)的计组实验资料大全,软件安装包+实验指导书+代码+实验报告。虽然我至今还是没有学会,但是共享一下资源帮助一下后来的同学吧!
2019-12-21 20:48:43 12.62MB 计组
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使用java语言编写一个单功能非线性流水线的调度程序。输入为预约表,输出为最优调度方案。
2019-12-21 20:48:25 106KB 系统架构
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使用verilog实现MIPS经典的五级流水线,巧妙的解决结构冒险、数据冒险、控制冒险。
2019-12-21 20:31:43 6KB MIPS 流水线 verilog
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组成原理实验课的内容 用Verilog语言写的流水线CPU,五级流水
2019-12-21 20:23:33 4.33MB Verilog 流水线CPU
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北邮 计算机系统结构实验二——流水线及流水线中的冲突
2019-12-21 20:23:02 488KB 流水线
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MIPS五级整数流水线模拟系统的实验报告,有简单的设计文档和源代码
2019-12-21 20:12:01 969KB mips 模拟器 simulator
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