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Verilog数字系统设计教程第17章RISC-CPU代码
Verilog数字系统设计教程第17章RISC-CPU代码
2024-04-28 16:35:17
9KB
FPGA
Verilog
1
西工大计算机组成与结构基础实验满绩单周期、流水线CPU代码、报告
实验分块在压缩包内,包含所有.v源文件,有的有QuestaSim或Vivado仿真工程,含有单周期和流水线报告各4份,最终实验成绩满绩。
2022-11-03 15:20:31
20.32MB
西工大
计算机组成
CPU
流水线
1
单周期cpu代码.zip
单周期cpu代码.zip
2021-11-21 15:25:49
233KB
单周期
cpu
1
主板BIOS升级CPU代码工具(附教程)
解压得到两个文件,CBROM195是提取CPU代码和刷入CPU代码的工具,需在DOS环境下运行,READ是教程文档,打印出来对着做就能无师自通了。 当然,CBROM的功能远不止于此,还能将显卡BIOS刷入主板,也能刷入对其它PCI设备的支持,只要你有钻研精神,就能发挥CBROM的强大功能。
2021-08-16 15:23:04
89KB
主板
BIOS升级
CPU代码
CBROM195
1
实现31条mips指令的流水线cpu代码
Xilinx_Spartan-3实现31条MIPS指令流水线CPU代码采用VerilogHDL语言编写,包括UCF文件,如有问题请发正确代码到zjuwh@sina.cn,谢谢
2021-05-22 13:24:49
95KB
流水线cpu
1
流水线CPU代码设计
北航计算机组成课程设计 支持20条指令的流水线CPU的Verilog代码实现,内包含源代码和相应的测试文件
2020-01-03 11:17:35
31KB
流水线CPU
1
Verilog 单周期CPU代码 及汇编代码 9条指令
Verilog 单周期CPU代码 及汇编代码 完美运行各种代码
2019-12-21 20:56:35
1.21MB
Verilog
单周期CPU
1
电子科技大学计算机组成原理实验代码 Mips_CPU代码
自己做实验的时候写的代码,保证编译直接可以用,仿真跟下载FPGA开发板都做了,后面的附加题也有。
2019-12-21 20:48:52
2.77MB
Verilog
Mips
CPU
1
设置Python进程运行于固定CPU代码
Python的线程在多核情况下,由于GIL的存在,运行效率会比单核情况下还低,这个时候,可以通过设置运行Python代码的进程所在的CPU以提高线程的性能,达到和单核处理器时一致的性能。该代码从 https://pypi.python.org/pypi/affinity/0.1.0 修改而来,去掉了原代码中对pywin32的依赖。
2019-12-21 19:56:19
2KB
affinity
python
多核
1
支持中断处理的流水线CPU代码设计
北航计算机组成课程设计, 支持50条指令和中断异常处理的流水线CPU,内包含源代码和相应的测试文件
2019-12-21 19:29:36
31KB
中断处理,P7
1
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